小柚

13800138000|xiaoyou_fpga@163.com|上海市

个人总结

电子工程专业应届生,专注于FPGA开发与数字电路设计。具备扎实的Verilog编码能力与Cadence工具使用经验,在校期间完成多个高速接口与信号处理项目。熟悉PCB设计流程,对金融量化硬件加速有浓厚兴趣,期待在半导体或金融科技领域深耕。

工作经历

FPGA开发实习生

星辰科技

2025-07 - 2025-10
  • 参与基于Xilinx Zynq平台的视频采集卡开发,负责MIPI接口逻辑实现,将数据传输延迟从12ms优化至8ms
  • 协助完成PCB板级调试,定位并解决3处电源完整性问题,确保模块稳定运行
  • 编写自动化测试脚本,覆盖率达85%,减少人工验证时间约40%

项目经历

高频交易信号预处理系统

校内实验室

2025-03 - 2025-06
  • 设计并实现基于FPGA的实时数据滤波模块,处理吞吐量达200Mbps,满足低延迟要求
  • 使用Verilog编写状态机控制逻辑,资源占用降低15%,时序收敛一次通过
  • 配合算法团队完成联合仿真,系统整体响应时间缩短至微秒级

多通道数据采集卡设计

课程设计

2024-10 - 2025-01
  • 独立完成4通道ADC采集系统的原理图设计与PCB Layout,信号信噪比优于65dB
  • 采用Cadence Allegro进行四层板设计,通过EMC预兼容测试
  • 编写Firmware驱动代码,实现USB3.0高速传输,实测速率稳定在350MB/s

教育背景

杭州电子科技大学

本科 · 电子信息工程

2022-09 - 2026-06

技能专长

FPGA开发

Verilog HDL · Vivado · ModelSim · Xilinx Zynq · 时序约束

电路设计

Cadence Allegro · Altium Designer · 四层板设计 · EMC/EMI整改

硬件技能

PCB Layout · 示波器调试 · 信号完整性分析 · 电源设计

编程与工具

C/C++ · Python · Git · Linux基础

领域知识

数字信号处理 · 高速接口协议 · 金融量化硬件加速

校招简历入门2026/10/29

FPGA/硬件开发工程师简历范文(电子/半导体/金融量化校招)

FPGA/硬件开发工程师 电子/半导体/金融量化 应届生

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适用人群

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