小柚

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个人总结

电子科学与技术硕士应届生,专注高速数字电路与信号完整性设计。熟练掌握Cadence/Altium工具链,具备从原理图到PCB Layout的全流程开发能力。在FPGA逻辑验证及嵌入式硬件系统方面有扎实的项目落地经验,追求高可靠性与低噪声的硬件设计方案。

工作经历

硬件开发实习生

烽火通信

2025-07 - 2025-10
  • 负责光传输设备主控板的原理图优化与PCB Layout检查,协助解决DDR4布线中的时序冲突问题,将信号误码率降低至10^-12以下。
  • 参与电源模块的EMC整改测试,通过优化去耦电容布局与接地策略,使辐射发射值在关键频点下降6dB,顺利通过入网认证。
  • 编写硬件测试脚本自动化采集电压电流数据,将单板测试效率提升40%,累计完成3款板卡的回归测试。

硬件助理工程师

长江存储

2023-12 - 2024-02
  • 协助资深工程师进行存储器测试板卡的维护与升级,整理BOM清单并核对元器件封装,减少物料错误率。
  • 参与高速接口(PCIe/SATA)的信号质量测试,使用示波器眼图分析协助定位阻抗不连续点,提出3处Layout改进建议并被采纳。

项目经历

基于FPGA的高速数据采集系统设计

华中科技大学实验室

2024-09 - 2025-06
  • 独立设计四层PCB板,完成FPGA最小系统及ADC驱动电路的原理图绘制,控制阻抗误差在±10%以内以确保信号完整性。
  • 使用Verilog编写数据缓存逻辑,实现100Msps采样率下的数据无损传输,并在ModelSim中完成功能仿真验证。
  • 调试过程中定位并解决了时钟抖动导致的采样不稳定问题,系统连续运行72小时无故障,达到项目验收指标。

便携式嵌入式医疗监护仪硬件研发

校企合作项目

2024-03 - 2024-08
  • 负责模拟前端电路设计,针对微弱生物电信号设计多级放大与滤波电路,将信噪比提升至65dB以上。
  • 选用低功耗MCU进行系统整合,优化电源管理策略使整机待机电流降至15μA,续航时间延长30%。
  • 主导小批量试产跟进,协调工厂解决贴片良率问题,最终首批50台样机一次性点亮成功。

教育背景

华中科技大学

硕士 · 电子科学与技术

2023-09 - 2026-06

武汉理工大学

本科 · 电子信息工程

2019-09 - 2023-06

技能专长

设计工具

Cadence Allegro · Altium Designer · OrCAD · PADS

硬件技能

原理图设计 · PCB Layout · 信号完整性分析 · EMC/EMI整改 · 阻抗控制

嵌入式与逻辑

FPGA开发 · Verilog HDL · ARM Cortex-M · C语言

测试与仪器

示波器 · 逻辑分析仪 · 频谱仪 · 万用表

校招简历进阶2026/9/6

硬件开发工程师简历范文(电子/半导体/通信校招)

硬件开发工程师 电子/半导体/通信 硕士应届生

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突出原理图/PCB设计与信号完整性实战项目
展示Cadence/Altium及FPGA嵌入式硬件开发技能

适用人群

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