今日校招速报：27 家新开岗位汇总（银行/制造/互联网）
UP 简历整理今日 27 家企业秋招新动态，覆盖银行、制造、芯片及互联网行业。重点解析天津滨海农商行等国企窗口期，帮应届生快速筛选高匹配度岗位，避免盲目海投。
小柚
13820268899|xiaoyou_circuit@163.com|深圳市
个人总结
电子科学与技术专业应届生，专注于高速电路设计与PCB Layout。熟练掌握Cadence Allegro及OrCAD工具，具备多层板设计实战经验。在校期间主导完成两项硬件开发项目，擅长信号完整性分析与电源模块优化，致力于在人工智能硬件领域深耕。
工作经历
硬件实习工程师
海康威视
- 使用Cadence Allegro协助团队完成安防摄像头主控板的4层PCB Layout，独立负责电源模块布线，将电源噪声降低了15%。
- 参与OrCAD原理图审查工作，修正了3处关键信号阻抗不匹配问题，确保后续打样一次成功。
- 编写BOM表并跟进元器件采购，通过优化封装选型将单板物料成本缩减约8%。
项目经历
基于RISC-V的AI边缘计算盒子硬件设计
校电子创新实验室
- 主导核心板原理图设计，采用OrCAD绘制6层板架构，成功集成NPU模组与DDR4内存，信号速率达3200Mbps。
- 负责高速差分线布局与阻抗控制，通过仿真优化走线策略，使眼图裕量提升20%，满足USB3.0传输标准。
- 解决DDR布线时序收敛难题，将启动时间从15秒缩短至9秒，项目最终获省级电子设计竞赛一等奖。
便携式高精度数据采集仪
个人独立项目
- 独立完成从需求分析到PCB制板的全流程，设计双层板结构，利用Allegro进行高密度互连布局，板卡尺寸控制在8cm*5cm。
- 优化模拟前端电路接地设计，有效抑制工频干扰，使ADC采样信噪比提升至72dB以上。
- 焊接调试并编写底层驱动，实现多通道同步采集，数据丢包率低于0.1%。
教育背景
杭州电子科技大学
本科 · 电子科学与技术
技能专长
EDA工具
Cadence Allegro · OrCAD Capture · Altium Designer · Mentor Xpedition
电路设计
高速PCB Layout · 信号完整性分析 · 电源完整性设计 · EMC/EMI整改
硬件技能
原理图绘制 · 多层板叠层设计 · 阻抗控制 · BOM管理
仪器与测试
示波器 · 逻辑分析仪 · 频谱仪 · 万用表
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核心亮点
精准匹配人工智能/电子制造校招需求
突出Cadence、Allegro、OrCAD及PCB Layout技能
包含电路设计项目实战与实习经历
适用人群
本范文特别适合硬件设计工程师岗位的求职者参考学习， 通过具体的工作经历和项目经验展示，帮助您了解如何突出人工智能/电子制造 行业的核心竞争力。
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